XUP官方指定的入门级FPGA教学板卡-Basys3
产品描述
Basys 3是一款可由Vivado®工具链支持的入门级FPGA开发板,带有Xilinx® Artix®-7 FPGA芯片架构。该款产品是广受欢迎的Basys系列FPGA开发板中最新的一代,特别适合刚开始接触FPGA技术的学生或初学者。Basys 3秉承所有Basys系列开发板一直以来的特色:即用型的硬件,丰富的板载I/O口,所有必要的FPGA支持电路,免费的软件开发平台,以及适合学生群体的售价。
为了帮助工科学生实现专业级的工程试验表现,Digilent为新一代的Basys3带来了性能上的极大提升,包括:
更多的I/O:
用户界面开关加倍,板载输出的数量加倍,更新外部接口的数量(从6引脚单排Pmods更新至12引脚双排Pmods),并且包括首次在Basys系列设备上加入USB-UART桥接功能。
新的芯片架构应对新的编程挑战:
从Spartan®-3E系列芯片改为Artix-7级别的芯片,Basys 3在硬件性能上取得了卓越的提升。新的Artix FPGA逻辑单元数量翻了15倍(从2,160到33,280),并且从倍增器更新到了真正的DSP切片。RAM的容量也增加了超过26倍。
业界首款具备SOC能力的设计套件:
Basys 3最重要的改变就是升级为可由Xilinx Vivado®支持。作为最为先进的设计工具链,Vivado为全球专业工程师所广泛应用,相比ISE®,Vivado能提供更好的用户设计体验和硬件功能实现。这些功能包括集成的IP工具(可缩短开发时间达10倍)和Vivado Logic/Serial I/O分析仪*。
*仅适用于Vivado设计版–相关版本的Basys3支持文档请浏览Digilent的维基网站。
产品数据:
设备/IC: Xilinx Artix-7 FPGA (XC7A35T-1CPG236C)
连接器:
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USB A
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USB micro-B
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4个12引脚Pmod连接器
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VGA
编程:专为Vivado设计套件设计
产品特点:
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Xilinx Artix-7 FPGA: XC7A35T-1CPG236C
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33,280个逻辑单元,5,200个切片(每片包含4个6-input LUT和8个触发器)
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1,800Kbits的快速随机存储器
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5个时钟管理,每个带有一个锁相环(PLL)
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90个DSP切片
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内部时钟速率超过450MHz
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片内模数转换器(XADC)
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Digilent USB-JTAG端口,支持FPGA编程和通信
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专为Vivado设计套件所支持。扩展功能都可以通过购买设计版本获得
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免费标准WebPACK™下载使用权限
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串行闪存
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USB-UART桥接
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12位VGA输出
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USB HID主机的鼠标,键盘和记忆棒
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16个拨码开关
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16个用户LED
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5个用户按键
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4位7段显示器
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4个Pmod连接器
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3个标准的12引脚Pmod
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1个两用XADC信号/标准的Pmod
产品包含:
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Basys 3 FPGA开发板
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带有保护泡沫保护的Digilent专用纸箱
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软件支持:
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Basys 3 可以使用 Digilent 的 Adept 软件进行编程。Digilent Adept 是一种独特而强大的解决方案,可让您与 Digilent 系统板和各种逻辑设备进行通信。在此处了解有关 Adept 的更多信息。
要为您的 Basys 3 创建和修改设计,您可以使用 Xilinx 的 Vivado 设计套件。Vivado 是一款专为综合和分析 HDL 设计而设计的软件。Basys 3 由 Vivado 设计套件的免费 WebPACK 版本支持。
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技术文档:
教程:
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介绍如何安装 Vivado 和 Vitis,这是用于创建面向 Digilent FPGA 开发板的硬件和软件应用程序的开发环境。
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介绍如何使用 Vivado 和 Vitis 创建硬件和软件设计,该设计使用处理器来控制按钮和 LED。
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演示如何使用 Vivado 创建一个让单个LED闪烁的简单设计。
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Digilent Pmod IP 可用于从裸机软件控制连接的 Pmod。
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应该注意的是,并非所有 Pmod 都受支持,并且 Pmod IP 仅在 Vivado 2019.1 及更早版本中受支持。
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- 实验-02 4输入逻辑门设计实验
- 实验-03 利用与非门设计或门实验
- 实验-04 四人表决电路设计实验
- 实验-05 2选1多路选择器
- 实验-06 4选1多路选择器
- 实验-07 4位2选1多路选择器
- 实验-08 双4选1数据选择器设计
- 实验-09 全加器设计
- 实验-10 8选1数据选择器
- 实验-11 4位比较器
- 实验-12 四位数值比较器设计
- 实验-13 8位数据比较器
- 实验-14 二位比较器
- 实验-15 3线-8线译码器设计
- 实验-16 利用74LS138译码器的全加器设计
- 实验-17 七段数码管显示实验
- 实验-18 4位七段数码管显示实验
- 实验-19 带消隐的七段数码管显示实验
- 实验-20 8线-3线编码器实验
- 实验-21 74LS148编码器实验
- 实验-22 4位二进制-BCD码转换器
- Digilent Basys 3系列-FPGA设计实例-01 在Vivado安装Digilent板卡支持文件
- Digilent Basys 3系列-FPGA设计实例-02 简易数字钟设计实验
- Digilent Basys 3系列-FPGA设计实例-03 基于Verilog的七段数码管实验
- Digilent Basys 3系列-FPGA设计实例-04 Vivado 74系列IP封装
- Digilent Basys 3系列-FPGA设计实例-05 HDL计数器设计实验
示例项目:
注意: 这些项目支持的 Vivado 最新版本是 2020.1。
使用Basys3板创建一个简单的示波器在 FPGA 上运行的 VHDL 中创建 Basys 3 板和计算机终端之间的 UART 接口的教程。该项目使用 HLS在Basys3板上实现了数字骰子滚轮。Verilog中Pmod ALS(8位ADC)的SPI接口代码是从零开始实现的,并传输到Basys3 FPGA板上的7段显示器。这个小型项目的目标是使用 FPGA 的高级合成来驱动 4 相双极步进电机。该项目在 HLS 中实现了一个 UART 发送逻辑设计。这个迷你项目展示了如何使用 C/C++ HLS 在 7 段上显示浮点数。该项目通过实现 0-9 加/减计数器展示了高级综合在描述数字系统方面的能力。HLS 中组合电路的重要性通过一个示例,该项目展示了 HLS 中组合电路设计的影响。其他资源:
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3D CAD 文件 – STP 文件
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Basys3参考推荐:
《基于Xilinx Vivado的数字逻辑实验教程》全书基于Basys3开发平台,利用85个例程,详细介绍了数字逻辑实验的基本设计方法。内容由浅入深,循序渐进,易于学习。提供了大量设计实例,内容详实、系统、全面。
Basys3更多资源请联系Sytek梭鱼智能www.sytek.ltd